IC后端设计交流
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- · pr时trace scan出现问题求教12-31
- · 求助:icc row m1电源开路问题12-31
- · encounter中pin不能按顺序放置12-31
- · 请教数字后端时序12-31
- · 能耗延时积 功耗延时积 的问题12-31
- · RC综合后,需不需要仿真结构级的verilog代码?如何仿真?请大牛们指点12-31
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- · AntAreaRatio是什么错误?12-31
- · 关于一个设计里面rst连接了同步复位和异步复位的DC约束问题12-31
- · 关于reconvergent的问题12-31
- · 求助Encounter Warning:failed to add edge...12-31
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- · 请教一下CTS中做tree的cell为何有inv 和 buffer 两种12-31
- · tcl 求解12-31
- · ICC 兩module 中的CLK問題12-31
- · 关于上下沿寄存器问题12-31
- · 随着工艺发展,DC用到的db越来越多,应该如何选取,clock又应该如何收紧12-31
- · 如何在macro的上下两边加endcap cell12-31
- · DC中的wire_load_model问题?12-31
- · 关于load split的操作12-31
- · 求教encounter nanoroute 的时候报错12-31
- · starrc怎么抽不同温度下的spef12-31
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