IC验证交流
- · 如何用perl 启动vcs 进行编译仿真跑cases01-01
- · 用irun来仿真systemVerilog01-01
- · vcs core dump01-01
- · analysis_port实例化疑问01-01
- · 向大佬们求助啊!uvm_reg_data_logic_t疑问01-01
- · VCS2010.06能否编译uvm1.1的库?01-01
- · Sigma Delta ADC 特性驗證 ENOB NFB01-01
- · 寻求formal验证的一些资料01-01
- · 看了systemverilog验证之后还是有点不懂01-01
- · 这段verilog代码好奇怪01-01
- · 覆盖率收集过程中如何处理DUT代码修改的问题?01-01
- · interface with clocking block01-01
- · 关于questasim中vcover merge的合并结果问题01-01
- · 在questasim中使用vmm方法01-01
- · UVM 交互式怎么完成?01-01
- · 大家测试ADC的时候用什么滤波器呢01-01
- · 还要base sequence吗?01-01
- · pure virtual funtion01-01
- · 全定制的ASIC能不能用UVM去验证呢?01-01
- · 求大神写一个spyglass cdc教程,十分感谢01-01
- · 什么叫corner case?01-01
- · 求verdi的使用教程!01-01
- · 转换pattern 遇到Error : maxinum number of waveforms01-01
- · $onehot 和 $onehot0的区别01-01
- · UVM sequence中如何插入复位01-01
栏目分类
最新文章