FPGA,CPLD和ASIC
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- · dc综合时对于macro lib的处理11-26
- · 请教DDR2的突发模式。11-26
- · ASIC的前端需要学的东西11-26
- · modelsim se 找不到已经编译好的altera 库11-26
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- · 现在市场上有无SATA IP Core 卖 (无内容)11-26
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- · 寄存器被综合器综合掉了,如何才能避免11-26
- · Spartan3a 使用LVDS问题11-26
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- · verilog code,2种方式,哪种好?11-26
- · reg 变量 wire变量 always敏感变量不全11-26
- · DC综合“run out of memory"11-26
- · 倡导多提出一些有深度的问题,当然也希望大牛们能对有深度的问题展开深入讨论11-26
- · 初学可编程IC,是选择FPGA还是CPLD?语言是选择VHDL还是Verilog?11-26
- · 帮忙推荐一款FPGA开发板:千兆网+DDR2+USB2.0+音视频+TFT液晶显示+PCI-E(可选)11-26
- · 求助下关于ISE中无法进行后仿真的原因11-26
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