FPGA,CPLD和ASIC
- · 各位高手,小弟请教一个modelsim问题!12-25
- · 谁有foundation 4.1 的Registration ID!12-25
- · 求助:关于block,process,procedure,function,component之间的调用关系总结12-25
- · 关于例化元件的问题12-25
- · 一个入门者的问题(vhdl)12-25
- · #推荐#很好的学习网站12-25
- · RFID基带求助!12-25
- · 一个关于FPGA调试时遇到的郁闷问题12-25
- · 有时钟输入的slave接口模块如何设计?12-25
- · 问个FPGA配置的问题12-25
- · 请教:数字集成电路测试设备12-25
- · 请教个简单的时序问题12-25
- · 总线上容性负载多的后果12-25
- · 请教:所谓数字ic设计做到系统级是指什么?12-25
- · 有个代码高人讲解一下12-25
- · 请高人指点:微电子本科能做ic吗?12-25
- · dvb发送卡设计大概方向12-25
- · 怎么实现占空比1:1的三分频?12-25
- · 如何把数字逻辑变成芯片12-25
- · 高手给一个关于奇数分频的verilog代码12-25
- · 请教高人!关于双向差分I/O口的问题12-25
- · 请教一个sta问题12-25
- · 求助:这个问题如何设计?12-25
- · 请教高手学习VHDL的好方法,请详细点12-25
- · 有人对systemverilog这种新的语言有研究么?12-25
栏目分类
最新文章