IC后端设计交流
- · 在做功耗分析时,clock buffer fanout对最终结果的影响是怎样的12-31
- · calibredrv里怎么move一个gds cell ?12-31
- · 在做floorplan时,channel中用加tap cell 吗?12-31
- · 求 Dorado's Tweaker user guide12-31
- · Virtuoso ic610安装问题!,江湖救急!?12-31
- · PARA-075 (error) Could not resolve net12-31
- · 后端面试--每日一题(036)12-31
- · 求这些proc的源代码 parse_proc_arguments and define_proc_attributes12-31
- · pex提取寄生参数出错,求助12-31
- · 请问如何用Calibre导出可以给PT做STA的verilog网表以及SPEF12-31
- · 关于用calibre抽取spef的问题12-31
- · 关于place前后timing差别很大的问题12-31
- · pnr后网表 pin的排列顺序12-31
- · 综合后仿真12-31
- · 请教ICC 版本问题12-31
- · ICC打开design 错误12-31
- · 请问VCS后端一般用来做啥12-31
- · 求教.cdB noise library是工艺厂提供的还是后端工程师用工具提取出来的呀12-31
- · 关于LVS BOX12-31
- · 已解决--set_wire_load_model的选择12-31
- · DC综合时候出现几种报错不知道怎么解决12-31
- · 请教pre_driver和post_driver?12-31
- · dbdiff 快速flatten lvl12-31
- · 如何用TSMC的标准单元库实现数字电路的逻辑综合?12-31
- · 关于v2lvs转换网表的问题,急!12-31
栏目分类
最新文章