IC后端设计交流
- · 有人知道ISSCC上发表的paper在哪里寻找吗?12-31
- · 关于三种pad的供电问题12-31
- · 关于filler cell用来保持power和ground连续性的疑问?12-31
- · add_tap_cell_array命令问题12-31
- · Encounter: M1 spacing error12-31
- · 求助标准单元库中单元高度相关的track具体含义?12-31
- · 关于DRACULA的问题,drc ,./jxrun.com12-31
- · Encounter: verifyGeometry 显示的short violation12-31
- · preroute_standard_cells12-31
- · 关于标准单元库中单元的高度12-31
- · 请教一个clock gating的问题,在线等12-31
- · encounter读lef有warning怎么解决12-31
- · 报hold timing的时候,lauch 和capture的clock path为什么用的不一样的corner?12-31
- · stand cell filler可以保持rail的连续性,这个怎么理解?12-31
- · 如何从版图或者电路生成逻辑网表文件(.v文件)12-31
- · clock gating问题12-31
- · DC中report_area给出的是等效门数还是面积?12-31
- · 从PLL输出的多个clock怎么设置其约束12-31
- · 请教下 PAD结构中的AL层 是什么?12-31
- · 新人,求教ICC如何在Port端口自动加上Port的名字12-31
- · ENCOUNTER布局布线有可能增减FF的数目吗?12-31
- · 自底向上如何做12-31
- · help 逻辑综合时钟约束问题12-31
- · cadence DRC验证的问题12-31
- · 请问ets提取出来的sdf文件中延时值会有负的么?12-31
栏目分类
最新文章