IC后端设计交流
- · 求助在cadence中仿数字电路的话,testbench怎么用啊?12-30
- · 关于tetramax dc网表内嵌一个dc做的ip core问题。12-30
- · 新手请教:IP核(eeprom)的时序问题12-30
- · 含有spare_cell的网表如何做PT呀12-30
- · ICC怎么忽略error12-30
- · ICC有可以自作standar cell的流程吗?12-30
- · Macro Cell做时钟树的问题12-30
- · 创建库时,读取工艺库时有几个Warning,这个应该没问题吧!12-30
- · 怎样用starRC抽取寄生参数做spice仿真12-30
- · CTS spec file 中几个命令的意思12-30
- · dc后仿问题?12-30
- · 关于DC后进行后仿的问题12-30
- · power stripe 走多层问题12-30
- · ADIsimPLL12-30
- · 请问double bonding是什么意思?12-30
- · 流片芯片测试12-30
- · DFT S19 Violation12-30
- · 后仿时间违例?12-30
- · 保持时间(新手问题)12-30
- · 修复时序违反的方法12-30
- · 由flat layout发现的一个问题。牛牛们给看看啊12-30
- · 请教下大侠们LDO版图12-30
- · 请教关于max_fanou的设置和为例问题12-30
- · 请教大家CTS都是怎么做的?12-30
- · 为什么输出transition与电阻无关?12-30
栏目分类
最新文章
