FPGA,CPLD和ASIC
- · 望高手指点12-25
- · 请教4位共阴极数码管的用法12-25
- · 问大家个事12-25
- · jtag是一个标准,那么是不是所有的jtag仿真线都是一样的啊?12-25
- · VERILOG描述的CLA的性能问题12-25
- · 两块PCI卡就死机,向大家请教,并祝大家节日快乐!谢谢12-25
- · 这个FPGA芯片的接口如何设计?12-25
- · 那位高手用过cadence的IC512-25
- · 问一个quartus仿真流程问题(用synplify综合生成的edf文件加入工程中)12-25
- · module sim &&quartus12-25
- · VHDL实现PCI配置寄存器12-25
- · 问一个fpga设计问题,设计时速度是ns级的,在输入是ms级时是不是可以运行良好呢12-25
- · 问一个quartus2 4的奇怪问题12-25
- · fpga开发板的原理!12-25
- · 看看俺的这个程序,有错误编译不过去12-25
- · 大侠们,来帮帮忙!12-25
- · 请教Altera有没有军档的CPLD,何型号?谢谢! (无内容)12-25
- · MD5的FPGA实现求助....12-25
- · 问:pci的vhdl编址问题12-25
- · 一个cpu内核的问题?12-25
- · 讨论一下:PCI 总线开发12-25
- · 要做4路E1复用到E2的FPGA设计,4路E1如何共享一块RAM呢?12-25
- · 请教:信号的电平划分12-25
- · 低速USB设备数据传输速率?12-25
- · 问:下载问题,高手救命!12-25
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