FPGA,CPLD和ASIC
- · Libero 软件操作11-16
- · 打开Libero Soc11.8电脑鼠标和触摸板无法使用11-16
- · UART 软核 测试11-16
- · 请问有人用过这块Stratix II官方开发板吗,Altera官网上怎么也找不到这块开发板对应的资料11-16
- · 求助:使用FPGA将光线信号SPDIF 转为I2S或者I2S转为SPDIF11-16
- · 基于FPGA的音频播放器系统11-16
- · 爱好自学11-16
- · 通信(CAN通信、红外通信)控制IIS音频11-16
- · 以太网摄像头图像传输11-16
- · +与芯航线的遇见11-16
- · +开箱静态体验11-16
- · 对小梅哥FPGA的学习研究11-16
- · 有木有想搞基于fpga车牌识别的想练练手,求队友,互相交流qq83684306511-16
- · 赛灵思的DDR3读写地址一直重复怎么办?11-16
- · ISEl联合modelsim 波形仿真出来 输出信号全是红线11-16
- · FPGA内核11-16
- · I2C 如何同时完成双目或者多目(同一型号)的传感器配置11-16
- · 基于fpga的四连通域算法,有木有做过?有偿请求分享代码11-16
- · 想要用FPGA做可调频率的正弦信号发生器11-16
- · 为了消除跨时钟域时序违例,跨时钟域的信号做两级寄存器寄存后,然后set falsh path,这样处理没问题吧?11-16
- · 上变频问题11-16
- · lattice芯片复位引脚11-16
- · 求助:Quartus点击编译会弹窗报错,看情况是没有进入编译器。我应该怎么办啊/(ㄒoㄒ)/~~11-16
- · 想调用一下vivado里IP核的clock wizard模块,输入时钟为50M,输出为25M。11-16
- · 怎么判断一种算法适不适合用FPGA实现11-16
栏目分类
最新文章
