UART 软核 测试

我用verilog 写了UART Tx 的代码。
到目前为止，我先想测试UART传输，但我不太确定如何测试它。
我应该测试什么呢?
我不是要求测试代码。 我需要一些有关测试UART软核的指导。
谢谢！

1. module Tx_top(clk, reset, start, i_data, serial_out)   // UART transmitter :  parallel input, serial output
   
2. 
   
3. input clk;  // 48MHz
   
4. input reset;
   
5. input start;     // i_data is valid, so start transmission
   
6. input[7:0] i_data;
   
7. output serial_out;
   
8. 
   
9. wire baud_out;  // 9600bps baudrate clock
   
10. wire serial_data;  // output from serializer (TxUART)
    
11. 
    
12. TxUART tx (.clk(baud_out), .reset(reset), .start_tx(start), .i_data(i_data), .o_data(serial_data));
    
13. 
    
14. baud_generator bg (.clk(clk), .baud_out(baud_out));
    
15. 
    
16. shift_register sreg (.clk(baud_out), .reset(reset), .data_in(serial_data), .data_out(serial_out));
    
17. 
    
18. // FIFO tx_fifo (clk, reset, enqueue, dequeue, flush, i_value, almost_full, almost_empty, o_value);
    
19. 
    
20. endmodule

复制代码

1. `define Tx_IDLE_BIT 0
   
2. `define Tx_START_BIT 1
   
3. `define Tx_DATA_BITS = ALMOST_FULL_THRESHOLD;
   
4. assign almost_empty = count <= ALMOST_EMPTY_THRESHOLD;
   
5. assign o_value = data[head];
   
6. 
   
7. always @(posedge clk)
   
8. begin
   
9.     if (reset) begin
   
10.         head <= 0;
    
11.         tail <= 0;
    
12.         count <= 0;
    
13.     end
    
14. 
    
15.     else begin
    
16.         if (flush) begin
    
17.             head <= 0;
    
18.             tail <= 0;
    
19.             count <= 0;
    
20.         end
    
21. 
    
22.         else begin
    
23.             if (enqueue) begin
    
24.                 tail <= tail + 1;
    
25.                 data[tail] <= i_value;
    
26.             end
    
27. 
    
28.             if (dequeue) begin
    
29.                     head <= head + 1;
    
30.             end
    
31. 
    
32.             if (enqueue && ！dequeue)
    
33.                     count <= count + 1;
    
34.             else if (dequeue && ！enqueue)
    
35.                     count <= count - 1;
    
36.         end
    
37.     end
    
38. end
    
39. 
    
40. endmodule

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最简单的就是发送一个数，正确点个灯