FPGA,CPLD和ASIC
- · 求教 为什么串口通信只能从PC接收一次数据11-15
- · 求VHDL语言的码型变换器设计11-15
- · integer 用法11-15
- · USB blaster for FPGA11-15
- · 新版破解器 Quartus II 13.1正式版(Windows版和Linux版破解)11-15
- · FPGA|CPLD|ASIC论坛诚招兼职版主,期待您的加入11-15
- · modelsim求帮忙一个VHDL程序(常用信号发生器),,11-15
- · 菜鸟求助,for循环不能仿真,求解决方法11-15
- · 工作一年后出于兴趣,想转做IC,之前是做软件,求大神意见11-15
- · 新手真心求 各位前辈师兄们解惑11-15
- · Xilinx EDK中的一个问题。。。Virtex-II Pro ML310板11-15
- · 1.1 EDK及SDK部分术语11-15
- · 如何选择合适的电源模块为FPGA供电11-15
- · quartus ii调用modlesim的问题11-15
- · 菜鸟求助各位大神 关于FIFO和DDS11-15
- · Modelsim仿真时候的data信号输入问题11-15
- · 新手求助关于rom的问题11-15
- · quartus仿真问题,11-15
- · 请求高手指点,感激不尽!11-15
- · 在下载时FPGA分频的问题11-15
- · 新人买原件求助11-15
- · 关于DS18B20设计温度计11-15
- · 格雷码转换成8421码的VHDL设计,编译出错不会改,求好心人...11-15
- · vhdl怎么添加50M内部时钟分频模块11-15
- · verilog11-15
栏目分类
最新文章