有关版图lvs的问题
时间：10-02
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电路版图本身是模拟部分和数字部分组合后的版图，数字电路设计时模拟模块作为黑框存在，现在有数字的cdl和模拟的cdl，如何跑整体的lvs
.include
全部include在一起来跑LVS