analog verification 职位怎么样?
时间:12-12
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rt,好像就是给模拟模块建模什么的,有前景么?
跟模拟电路设计有什么区别?
一个设计管子然后做layout
另一个直接用建模语言写行为级模型?
搞不懂
是的,主要用来验证功能,性能搞不了
国内貌似就LSI有这职位?
veriloga/ams modeling,大公司一般有的职位,一般用于比较复杂的chip。ADI/TI也有相关的职位