请教一个component video问题
时间：12-12
整理：3721RD
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模拟的分量信号输出，在smpte296m协议上规定tri-level sync是 -300mv到300mv,blan
k level为0.但是设计的时候DAC输出大于0，sync信号在50
mv到650mv,blank level在350
mv，是否可行？还是必须要加负的dc offset(-350mv).有朋友做过这方面的东东的吗？
k level为0.但是设计的时候DAC输出大于0，sync信号在50
mv到650mv,blank level在350
mv，是否可行？还是必须要加负的dc offset(-350mv).有朋友做过这方面的东东的吗？
找个spec看看去 TI 的 8135 是个通用DAC
不过接收端都是交流耦合的。。。有个1uf 或者0.1uf的隔直电容的