请教一个同步时钟，异步fifo的问题
时间：10-02
整理：3721RD
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fifo的读时钟是clk，写时钟是clk经过分频后的时钟clk_div，因为分频关系，clk和clk_div是同步时钟，那么我想问的是这个fifo要设计成同步fifo还是异步fifo呢?
用异步总是不会错的
读写时钟都不一样了，肯定异步FIFO啊
如果要做成同步，需要对后端提出来，因为可能涉及multi_cycle。做成异步通用性更高，只是面积大点而已。
同步简单，异步很复杂
谢谢回答，我也这么认为
恩，设计成同步的话两个时钟之间的逻辑是要单提出来列给后端的。
还想问下，是不是只要FIFO的读写时钟只要不同，不管这两个时钟是不是同步时钟，都必须设计成异步FIFO?
4楼说的很对。
只要能保证读数据的时候，数据已经稳定。FIFO只是一种方法，也有其他方法。这个要看你具体的需求，才好定一个最佳的方法。
好的，谢谢
可以使用异步FIFO,当然也可以是同步fifo,异步fifo最简单明了,同步fifo的话,需要对读进行适当控制,但是同步fifo面积小一些,根据项目需求定