微波EDA网,见证研发工程师的成长!
首页 > 研发问答 > 嵌入式设计讨论 > FPGA,CPLD和ASIC > 求教关于门级提参后仿问题

求教关于门级提参后仿问题

时间:10-02 整理:3721RD 点击:
本人用calibre pex提取gate level寄生参数(电路为sram),生成的寄生参数文件为spef,现在用hsim跑后仿,将spef文件反标到电路网表上,具体如下:在hsim跑仿真的.sp文件里表头加上电路网表文件’inc 路径/网表.cdl’,表尾用param hsimspef=路径/寄生参数.spef将寄生参数反标到电路网表上,然后跑后仿,发现前仿和后仿结果一样,猜测寄生参数文件没有反标上,但是不知道自己错在哪一步,求好心人指教,跪谢!

Copyright © 2017-2020 微波EDA网 版权所有

网站地图

Top