synopsys design compiler 综合时 特定的输入pin保持悬空
时间：10-02
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我想在综合后让某些特定的输入pin保持悬空该怎么操作呢?有没有这样的命令。dc综合会默认把这些悬空的脚都接上0。每次都要人为的删除，很麻烦
dont_touch是不是可以呢
dont_touch不可以，试过了。
记得可以设置的
这个操作是在自下而上的设计过程中，将综合过的子模块设置dont touch属性，那么在顶层综合时，底层的子模块不会受影响。
dont_touch不可以，试过了。