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模拟-verilog混仿求助

时间:10-02 整理:3721RD 点击:



本人最近使用cadence进行模拟-数字混合仿真,在仿真时出现如图所示的错误。不知道到底是哪里出错了。恳请各位指教,谢谢。

不懂,帮顶!

没弄过,帮顶!

有原语没有定义, io_cdsNetXXX

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