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怎么设置让FPGA不经过确定的区域

时间:10-02 整理:3721RD 点击:
怎么写UCF文件,才能让FPGA不经过确定的区域。比如virtex系列,我想要任意位置的CLB空着,该怎么设置

using “prohibit”



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刚读了下ucf文件的语法,怎么去添加prohibit,可以给个模板吗

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