微波EDA网,见证研发工程师的成长!
首页 > 研发问答 > 嵌入式设计讨论 > FPGA,CPLD和ASIC > 关于altlvds字节对齐的问题

关于altlvds字节对齐的问题

时间:10-02 整理:3721RD 点击:
我要实现的就是把AD芯片进来的串行数据变成并行的,从AD出来的除了串行数据外还有一个dco(时钟信号),这个时钟是双边沿取数的,也就是说我的串行数据速率是434M,这个时钟只有217M。另外还有一个fr信号,它是一个帧同步信号,它的上升下降沿对应的串行数据位都是最高位,也就是从最高位开始对数据并行化,我现在出现的问题就是字节对不齐,我也试过把fr那个信号通入altlvds里面的align字节对齐端口,但是最后 出来的结果还是字节不齐,想问问前辈我这到底是怎么回事呢,谢谢了

Copyright © 2017-2020 微波EDA网 版权所有

网站地图

Top