微波EDA网,见证研发工程师的成长!
首页 > 研发问答 > 嵌入式设计讨论 > FPGA,CPLD和ASIC > 求教高手啊! Xilinx ISE 13.2还能不能支持分区编译啦?

求教高手啊! Xilinx ISE 13.2还能不能支持分区编译啦?

时间:10-02 整理:3721RD 点击:
小弟想用Xilinx ISE的分区编译(Partition)功能,在Xilinx官网上找到个文档介绍怎么使用分区编译
但是现在发现ISE 13.2上的右键菜单里找不到那个"New Partition"的选项了。本人的FPGA是Virtex-5系列,资料上明确说明是可以支持分区编译的。请高人指点一下13.2上怎么用分区编译啊?
官网教程:http://china.xilinx.com/support/documentation/application_notes/c_xapp918.pdf
教程上的菜单截图

没有人用过这个功能吗? 自己顶一个

很想用,但是不会用设计大了还真不好搞~

thank you it is interreting software

不能用了 从12.1以后就没有partition的功能 貌似planhead有 参照http://www.eefocus.com/iweimo/blog/12-03/245947_2a0ae.html

Copyright © 2017-2020 微波EDA网 版权所有

网站地图

Top