微波EDA网,见证研发工程师的成长!
首页 > 研发问答 > 嵌入式设计讨论 > FPGA,CPLD和ASIC > xilinxFPGA中的DCM模块最大分频数为16,如何用DCM实现更高分频?

xilinxFPGA中的DCM模块最大分频数为16,如何用DCM实现更高分频?

时间:10-02 整理:3721RD 点击:
xilinxFPGA中的DCM模块最大分频数为16(3E 中的DCM),如何用DCM实现更高分频?

两个DCM级联



   是的,好想法!

也可以用BUFIO2来实现,或者PLL,
如果分频这么高,但分下来的频率很低的了,直接用记数器来分频。

上一篇:关于DC的使用
下一篇:关于ise ,求助

Copyright © 2017-2020 微波EDA网 版权所有

网站地图

Top