微波EDA网,见证研发工程师的成长!
首页 > 研发问答 > 嵌入式设计讨论 > FPGA,CPLD和ASIC > virsim 使用

virsim 使用

时间:10-02 整理:3721RD 点击:
弱问大家,怎么在不关闭波形窗情况下改代码重新仿真,即不用重新抓信号到波形窗看?

rebuild and start

我知道这个  可是每次都是显示rebuild command "csrc/vcs_rebuild" is not a valid file
这是什么原因?

Copyright © 2017-2020 微波EDA网 版权所有

网站地图

Top