微波EDA网,见证研发工程师的成长!
首页 > 研发问答 > 嵌入式设计讨论 > FPGA,CPLD和ASIC > Verilog HDL 如果没有定义数据类型

Verilog HDL 如果没有定义数据类型

时间:10-02 整理:3721RD 点击:
您们好, 请问一下, Verilog HDL 如果没有定义数据类型, 是不是一般的工具都会把它默认为wire? 谢谢!

如果没有专门对这个默认类型进行全局定义的话
那么 默认就是wire

谢谢!

对的

Copyright © 2017-2020 微波EDA网 版权所有

网站地图

Top