如何综合出一写四读的SRAM单元
时间：10-02
整理：3721RD
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我在RTL设计时需要一个一写四读的SRAM单元，行为级描述没有问题，但是综合的时候却找不到对应的SRAM单元，我需要评估设计的面积开销，所以不希望采用寄存器来实现，大家谁能给点建议?谢谢先！
通常的memory compiler做出的是1写1读的sram，比如artisan的。为了实现1写4读，肯定是要加上判决仲裁的电路。
In asic, there is no such cell.
Normally, can use two port SRAM(1 write, 1 read) + arbitor.
this should be hard IP , TSMC/SMIC/charter/UMC has no such memory compiler. but maybe IBM has such one
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Where can I get such kind of IP ?