基于FPGA的扫频信号源的研究与设计

L语言进行RTL级描述，并完成逻辑综合、布局布线、时序仿真及硬件测试，最终在硬件电路上验证了整个系统设计的正确性。测试结果表明，该扫频信号源的时钟频率可以稳定的运行于50 MHz，信号源的频率分辨率可以达到0.1 Hz，扫频范围可以在0～10 MHz之间任意设定，完全满足在中低端扫频仪中应用的要求。