混合信号FPGA的智能型验证流程

验证  

传统的混合信号ASIC发展遵循由下而上的方法。它牵涉到两个不同的小组：一个研发数字部分的写入RTL代码，而另一个在晶体管层级实作模拟电路。在验证方面，设计者一般使用Verilog-AMS或VHDL-AMS的高层级全芯片仿真以验证系统层级的行为，如功能、性能和迟滞等。这需要和最终电路关系密切的模拟行为模式。然而验证接口层级议题、时序、信号整合度和电源等晶体管层级的模拟还是需要晶体管层级的模拟。这也可以帮助避免模型和电路之间的不准确性或不当关联。最近几年出现了新等级的工具，允许混合信号共同仿真环境在指定的SoC中验证混合信号组件。  

在PSC流程中，混合信号仿真是没有必要的。对待组件内的模拟功能像开架式分离组件一般。就像组件厂商一样，数据规格所提供的模拟功能电子特征的许多信息依据实际硅的特征化数据。抽出详细的模拟行为后所产生的模式在全数字仿真器（如ModelSim等）中，就完全可以达到系统层级的验证。模拟输入是以真实或位向量值呈现在仿真测试基准中，一般是以测试基准工具产生的。  

有了此层级的抽出，针对混合信号FPGA所提供的基本验证方法和沿着标准处理的数字FPGA基本上是相同的。  

典型的PSC设计者会在设计过程中执行以下步骤：在Libero中产生并整合系统功能区块；透过Synplify或Synplify PRO合成设计；利用ModelSim验证设计；利用Libero Designer将设计编辑在Fusion PSC中以利后端实作；在ModelSim中利用后批注（back-annotated）时序再次验证。  

此基本流程让Fusion使用者可以利用经证实的方法，在设计过程中的任何阶段验证混合信号PSC的系统层级行为，就宛如全数字芯片般简单。此流程依据客户设计中整合其余数字系统的某个模拟输入组合执行仿真系统层级行为必要的工作。  

SoC发展概念上需要各式各样的专业技术，包括模拟设计、数字逻辑设计以及系统／结构定义等。随着整合层级的上升，此课题迅速地变得异常复杂，且FPGA发展常常牵涉到通常没有这类专业的一小组逻辑／FPGA设计工程者。