一种基于FPGA的新型误码测试仪的设计与实现

于加到添门的晶振信号与加到扣门的晶振信号的相位相差180度，因此当从添门加入一个晶振脉冲到或门时，相当于在扣门输出的晶振信号中间插入一个窄脉冲，也就使分频器输入端添加了一个脉冲，这样分频器的输出相位就提前了1/20周期。从而实现位同步。

　　2.2状态同步模块

　　状态同步模块主要包括逐位比较检测模块、误码统计与门限检测模块、并行输入与状态控制模块、状态并行比较模块、连"1"状态计数器模块。

　　（1）误码统计与门限检测模块：在时钟的节拍下，对误码脉冲计数，同时对时钟脉冲进行计数。若误码个数占时钟个数的30% 以上，则认为误码率很高，说明系统两序列的状态不同步，此时门限检测器将输出低电平，需要进行同步搜索。若误码个数占的比例较低，则输出高电平，说明此时系统已状态同步，不再进行同步搜索。

　　（2）并行输入与状态控制模块：当控制端为"0"时，该模块照原样将两组并行输入信号送到输出端，为"1"时，将所有输出信号置"0"。这时状态比较器的所有输入信号都电位相同并输出高电平，以表示系统已同步，进入同步保护状态。

　　（3）连"1"状态计数器模块：该模块的功能有两个：一是对状态比较器输出的连"1"状态进行计数，当计数器的计数量达到设置值时，计数器输出为 "1"，并控制"并行输入与状态

　　控制"电路，使各并行输出位置"0"。这样，状态比较器的各输入位都为"0"，则其输出为"1"，表示状态已同步；若状态不同步，则连"1"计数器的输出始终为"0"。连"1"计数器的另一功能是当其输出为"1"时，才使误码计数器进行计数。若在整个系统已同步后，出现了状态失步，则通过误码统计与门限电路的输出状态控制连"1"计数器。当连"1"个数到达设定的个数时输出为"1"，并送给并行输入与状态控制器，使其输出置为"0"，以实现同步保护控制。

　　3 结束语

　　本文设计的误码仪的优点是可以很方便的应用于基带传输信道的测试，可准确测量出基带传输信道的传输误码，且成本较低。