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想问一下高手,数字后端与数字前端最大的不同是什么?

时间:10-02 整理:3721RD 点击:
多多指教啊

最大的不同就是前端是数学,后端是物理!

前端是逻辑,后端是物理、硅片、图形

前端是逻辑,后端是物理

一般按照划分的标准
布局布线之前的ASIC设计流程都称为前端设计。
布局布线包括布局布线都是属于ASIC后端的设计了。
很明显:
前端基本要求:
verilog/VHDL HDL 数字逻辑,等都是基本的要求
还要求会用tcl写出脚本程序,如在modelsim仿真时,用脚本要比GUI快很多。
synopsys的DC和PT也是基本的需求,逻辑仿真器会使用。
前端主要的任务是把需求转换成实际的逻辑实现。
一定要学会划分模块,深刻理解模块的通信关系。
最后就是用verilog实现出来。
后端:
把前端的逻辑电路转换成版图设计,DRC,LVS,
最困难的就是要考虑时序关系,因为布线后,版图接近真实的环境,所以一定要满足时序关系。

说的好啊!

懂了,谢谢5楼的哈

5楼说的很好,受教了

受教了~

很明确

同意3、4、5楼

呵呵,被教育了。

谢谢5楼解释

目前国内后端人才严重不够,所以后端很好找工作,而且后端的工作经验积累很重要。但是如要要发挥更大的作用,还是看前端了。

果然明确

简单明了!

是的

学习学习,

领教了 啊

xiexie

前端是算术,后端是几何.

顶一下!

5楼的说得很好,受教了

五楼说的很好~

前段 主要是把代码 算法 架构 代码的设计与验证,写代码用的工具比如vcs verdi ncverilog 等等,比如写测试平台,如果代码设计,可以用verilog写testbench自测以下是否对阿,nlint检查格式 语法问题即可。送给验证工程师,他们 比如 用 e language 写测试台,对 hier 的 modules 进行验证。 没问题了,前段系统工程师,给出时钟复位方案,进行综合,生成网表,这个接口部门 前段也可以作,后段也可以作。最好前段、后段都要会综合,然后形式验证-〉DFT?(如果需要),-〉fm -〉P&R,-,,, ,-在后段的过程中,需要作eco,并且进行eco修复,同时出问题需要定位,及时反馈给前阶段(包括前段)。最好 前段 后端 DFT都了解一下吧。呵呵,胡说一通!见谅。

后端体力多 前段脑力多。其实都是体力活 呵呵;
发展好了,钱都不少!无所谓!不过感觉前段工程师能写写代码 -〉搞搞架构- 出个soc芯片,整个几千万还没准! 后端作牛了 ,很 舒服的 适合养生 也不错!

我觉得做好前端后端都做一点,这样才能理解的深刻

songwenjuan 说得很好

看来前端比较有前途啊。

受教了!

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