请问在后端里面需要怎样保证duty cycle
时间:12-12
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只要transition time保证就够了吗还是有其他考虑
谢谢
谢谢
通常这个由前端验证吧。
如果你非要看看,那就做后仿。
做上升下降沿的check呀,coding constrain for pulse width check and inactive pulse width check
ddr的有些clk output需要吧
min pulse width check可以来做