锁存器的静态时序是怎么分析的？
时间：12-12
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综合出来的电路有锁存器，做时序分析总出问题。请问PT遇到锁存器时是怎么分析时序的？
latch么？latch比较复杂点，open edge 和close edge不一样，会有timing borrow或者pass through, 看看STA manual吧，都会有介绍