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verilog如何在测试代码中指定仿真时间的长度

时间:10-02 整理:3721RD 点击:
如题,如何在TB文件中指定设定仿真时间的长度呢?每次在modelsim中敲打run x挺麻烦的。

initial begin #(TIME) $finish;end

如2楼所示

二楼解答完毕

二楼解答完毕

二楼解答完毕
也可以用 $stop();
可以停下,想继续仿也可以。

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