微波EDA网,见证研发工程师的成长!
首页 > 研发问答 > 嵌入式设计讨论 > FPGA,CPLD和ASIC > sdram问题

sdram问题

时间:10-02 整理:3721RD 点击:
sdram连续burst写操作正确,多次burst写操作中间间隔一段时间就可能出错,这个是为什么?如果降低时钟频率,也对了,会不会哪个参数配置的问题(O_O)?

哪个延迟没有配对吗?



   是不是两个写命令之间的间隔没有配对,控制器可能配置的不对

Copyright © 2017-2020 微波EDA网 版权所有

网站地图

Top