异步FIFO中rd_empty的问题
时间：10-02
整理：3721RD
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大家好！我是刚开始接触项目的新手，在用异步FIFO时，已经输入进来数据了，但rd_empty信号一直为高。不知道是什么原因，请求大家的帮助。万分感谢了~
不贴代码，这让别人怎么帮你分析呢
你的读时钟是自己造的吧
已经解决了，是因为程序比较大，模块比较多。在测试文件中，FIFO的读时钟没有例化在顶层，也就是说FIFO的读时钟没有加进去。