输入输出接口位宽可变如何实现~~~欢迎指导讨论
时间：10-02
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接口的输入输出位宽随时可变，这个怎么用VERLOG实现呢?不解中，求解释~
定义位宽用宏定义或者参数不就是随时可以改变的吗
以前见过一个IP核对于这种好像是这样实现的
`ifdef
.................
`else
..................
`endif