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FPGA时钟输出问题

时间:10-02 整理:3721RD 点击:
使用artix-7芯片输出125M的时钟信号,高电平可以达到3.3V,但是输出的低电平始终下拉不到零。这到底是为什么?希望有懂的人给我分析一下!



   测试端是否共地?
FPGA的GND是否共地?



   全部共地了

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