有一个问题,VHDL在同一个process里面可不可以写两个状态机
时间:10-02
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本人刚从Verilog到VHDL
敏感列表里边放那个状态呢
可以,嵌套的话就这样写
写十个都可以,为了功能清晰还是分开的好。利于修改
可以写多个,就是要注意状态机之间的接口清晰
