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关于ASIC时钟管理的问题

时间:10-02 整理:3721RD 点击:
FPGA里面有时钟管理的部分,可以管理时钟。但是ASIC外面晶振给的时钟是正弦波,在电路里面也是正弦波吗?还是变成了方波之后给电路提供时钟吗?

asic都是经过pll的方波

正弦波经过数字的IO后,就应该是方波了

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