微波EDA网,见证研发工程师的成长!
首页 > 研发问答 > 嵌入式设计讨论 > FPGA,CPLD和ASIC > ddr3 mig仿真数据乱序

ddr3 mig仿真数据乱序

时间:10-02 整理:3721RD 点击:





仿真中,数据写的顺序是1c1d1e1f,读出来 的数据变为1e1f1c1d?
咋回事?

貌似前两天有人发了个贴,问题跟你一样

我晓得了,写地址给的是38,是读地址给的不对了,地址应该加8,但是我给成 0x3c = 60,不是8的整数倍了,所以数据乱了。

Copyright © 2017-2020 微波EDA网 版权所有

网站地图

Top