如何用verilog实现一个环形振荡器
时间:10-02
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谁能帮帮忙,能在QuartusII上仿真出来就行,急
实例化N个(奇数个)反相器,首尾相连。中间插个与门接入复位信号。
仿真时候不行啊,
FPGA不适合做这个哈,FPGA提倡做稳态电路,非稳态是不可控的,跑着跑着就飞了。
