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xilinx的IO输出

时间:10-02 整理:3721RD 点击:
我从fpga内部管脚输出时钟给sdram,但是频率过大就没有时钟了,而且输出时钟的幅值随频率的增高变小!


可以尝试把输出时钟端口的驱动电流调成24mA,摆率设为fast。

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