微波EDA网,见证研发工程师的成长!
首页 > 研发问答 > 嵌入式设计讨论 > FPGA,CPLD和ASIC > 怎么用synplify 生成IP 网表?

怎么用synplify 生成IP 网表?

时间:10-02 整理:3721RD 点击:
FPGA 是Altera。 希望用Synplify综合一组RTL, 最后输出一个IP 网表,供其它人使用。
需要什么tcl 命令呀?
谢谢了。

一般综合完就直接生成网表了,就是*.edf, 也可以在tcl中添加命令:project -result_file "*.edf"

Copyright © 2017-2020 微波EDA网 版权所有

网站地图

Top