VCS仿真gate level网表文件，如何去掉时序信息让仿真更快？
时间：10-02
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现在用VCS仿真时，到手的已经是gate level的文件了，仿真起来速度很慢，有没有参数选项让VCS忽略掉太细层次的信息（如时延等），只跑RTL级的即可。
no timing
加选项+notimingcheck
不过也慢的，门级网表仿起来本来就慢。
帮助文档里面有这个例子。
我试过了，仿真时间和不加时基本相同，效果几乎没有。
不会，友情帮顶