求助 vHdl语言设计FIFO存储器 遇到麻烦
时间:10-02
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用FPGA设计FIFO存储器 ,前面AD转换后输入的数据位宽为8,后面DA转换芯片位宽为10 ,如和用vHdl语言把存储器高两位置零保证10位位宽,请发邮箱410154978@qq.com
在读取FIFO数据的时候,在高位补两个0不行啊?
