关于ASIC资源消耗评估和时序分析
时间：10-02
整理：3721RD
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我这里有一个抗干扰算法，老师让我从ASIC设计的角度来评估这个算法的资源消耗问题和时序问题，以此来验证这个算法能否ASIC实现，现在不知该如何入手，请各位大神指点一下哈，谢谢了！
再一个，时序分析在硬件实现中，时钟频率达到多少，时序一般会出现问题，这时时序分析必须要重点考虑?我这个算法用的时钟频率大概在60MHz。
以前我没有弄过ASIC，希望各位能够不吝指点一下，有没有一些ＡＳＩＣ数字设计方面一些基础的书帮忙推荐一下，我想好好学学，谢谢大家！
再一个，时序分析在硬件实现中，时钟频率达到多少，时序一般会出现问题，这时时序分析必须要重点考虑?我这个算法用的时钟频率大概在60MHz。
以前我没有弄过ASIC，希望各位能够不吝指点一下，有没有一些ＡＳＩＣ数字设计方面一些基础的书帮忙推荐一下，我想好好学学，谢谢大家！