about timing loop
时间:10-02
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timing loop是真正意义上面的组合逻辑的loop吗?
为什么我DC综合的时候都是报“C" and "Q"之间存在loop?
请指教!
为什么我DC综合的时候都是报“C" and "Q"之间存在loop?
请指教!
一般工具会自动进行broken的
如果是design上刻意做的, 那就無仿, STA會自己break掉來計算, 但如果不是原來設計, 那就要解掉