verilog中寄存器赋值问题
时间:10-02
整理:3721RD
点击:
我定义了一个reg [4:0]N 赋值的时候不小心令N=8'b0000_0010 结果仿真的时候 N=01010;请问这个1010是怎么经过verilog编译出来的?谢谢了~
自己先顶一下~~
N=8'b0000_0010, 应该是 00010 才对,N还有其他赋值语句吗?
难道是仿真的时候把定义位宽以外的高位截去了?
