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求助verilog代码--串行数据检测

时间:10-02 整理:3721RD 点击:
题目要求:
在输入的串行数据码流中含有F6F6F6282828图案,要求从输入的中检测该图案,并进行串/并转换设计,时钟频率为80MHz。

最好有完整的程序代码和测试激励代码

谢了

救命啊~怎么没人回复我

找本教材看看吧!

叫人直接写给你也太狠了吧

顶多30行代码,还是自己练习练习吧。

我也想要啊 有测试代码的更好

找本教材看看吧!

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