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如果用synplify综合,用ise p&A后时序不满足?

时间:10-02 整理:3721RD 点击:
如果用synplify综合,用ise p&A后时序不满足, 但又不能修改代码,有什么方法呢?能不能对某些特定的路径进行优化?

要去看FPGA对应器件手册和PR后的报告确认把FPGA利用好了

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