PLL的输入输出时钟需要再约束么?
时间:10-02
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在例化的时候已经明确指出了输入输出时钟的大小。所以我觉得在时序约束的时候就没有必要再对这个时钟进行约束了。工具就已经知道了。
不知道我这么想对不...高手指点。
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好!顶一个!
我也想知道 。
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时序不能满要求时,需要对PLL约束或重新生成PLL,本人经常更改相位,以满足时序要求。
